ミッドレンジFPGAに高速DDR3メモリコントローラーを実装します
FPGAに高速で高効率のDDR3メモリコントローラーを実装することは、手ごわいタスクです。最近まで、高速DDR3メモリデバイスに確実にインターフェイスするために必要なビルディングブロックをサポートしていたハイエンド（読み取り：高価）のみがサポートされていました。ただし、新世代のミッドレンジFPGAが開発されています。
このホワイトペーパーでは、設計上の課題と、特定のFPGAファミリーであるLatticeECP3がDDR3メモリコントローラーの設計を促進する方法を調べます。
詳細については、このホワイトペーパーをダウンロードしてください。
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